ASIC-FPGA转换工具需要的另一个功能是实现分区(partitioning)。因为ASIC越来越复杂，集成了更多的功能，为了更快、更经济地完成验证，设计人员需要将芯片的功能分散到多个FPGA中。
这个分区过程非常复杂，而且耗费时间。ASIC原型工具能够自动地将RTL分散到多个FPGA中吗?能够不需要修改RTL源代码?
ASIC原型工具支持自动分区和用户手动分区吗?这个工具支持I/O复用技术、允许用户共享管脚以克服管脚数量的限制吗?ASIC原型工具应当支持察看FPGA内部信号的状态的调试功能。验证工程师必须了解ASIC原型工具如何使用户测量并调整性能。
通过使用可编程逻辑作为原型设计平台，对ASIC功能进行研究和验证，设计人员能够快速地地发现潜在的缺陷，降低产品的综合风险，并达到上市时间的要求。
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